回路構成は一応 fix にしてぼちぼち配線していますが、配線量が多くてなかなか進まないです。ちなみに、最近は私は電源だけスズメッキ線で引いてから、0.16mm ポリウレタン線で引いています。0.29mm のほうが固くて線がフラフラしないので作業はしやすいんですけど、流石に太すぎる。page3 はロジアナ用の引き出し線です。
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Name U99KCTL; Partno KF007015; Date 20/10/10; Revision 01; Designer efialtes_htn; Company E. Design; Assembly System 18 TMS99105 decorder; Location U08; Device g20v8; /* *************************************************************** */ /* System 1Q IO decorder Glue logic */ /* */ /* *************************************************************** */ /* target device GAL20V8-15 */ /* *************************************************************** */ /** inputs **/ Pin 1 = CLK; Pin 2 = ale; Pin 3 = !mem; Pin 4 = !we; Pin 5 = bst1; Pin 6 = bst2; Pin 7 = bst3; Pin 8 = a06; Pin 9 = a07; Pin 10 = alsel; Pin 11 = a15; Pin 13 = !oe; Pin 14 = !wait; Pin 23 = !romw; /** outputs **/ Pin 15 = !inta; Pin 16 = !ie; Pin 17 = !bg; Pin 18 = sio; Pin 19 = !serrq; Pin 20 = !parrq; Pin 21 = clk2; Pin 22 = rdyo; /* logic equations */ is_rdy = (!sio & !a15 & !mem & !bst1 & bst2 & bst3) # (!sio & mem & !a15 & romw); ie = a15 & !mem & !bst1 & bst2 & bst3; serrq = !a15 & alsel & !a07 & !a06 & !mem & !bst1 & bst2 & bst3; parrq = !a15 & alsel & !a07 & a06 & !mem & !bst1 & bst2 & bst3; sio.d = is_rdy; rdyo = is_rdy # wait; bg = (!mem & a15 & !bst1 & bst2 & bst3 & !ale) # (mem & !ale); inta = !mem & bst1 & !bst2 & bst3; clk2.d = !clk2;
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